FPGA课程设计—数字密码锁
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FPGA基于Verilog HDL密码锁设计
1. 摘要 (3)
2. 题目来源: (4)
3. 理论分析 (4)
4. 实现过程 (5)
4.1顶层模块 (5)
4.2蜂鸣器模块 (7)
4.3显示模块 (8)
4.4控制模块 (13)
5. 实验结果 (17)
5.1顶层模块时序仿真： (17)
5.2蜂鸣器时序仿真 (20)
5.3显示模块时序仿真： (21)
5.4控制模块时序仿真 (23)
6. 总结 (27)
7. 参考文献 (28)
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