Quartus II简明操作指南
在前面的实验里，我们所有的实验都是基于这样一个观点，即将一个数字系统划分成合适利用已有的中小规模数字集成电路的功能的模块，然后将这些集成电路通过外部引线连接起来。现在开始我们将研究用可编程逻辑器件(PLD/FPGA)来进行数字系统设计。
可编程逻辑器件是一种大规模的集成电路，其内部预置了大量易于实现各种逻辑函数的结构，同时还有一些用来保持信息或控制连接的特殊结构，这些保持的信息或连接确定了器件实现的实际逻辑功能，当改变这些信息或连接时器件的功能也将随之改变。可编程逻辑器件的设计过程和传统的中小规模数字电路设计也不一样，可编程数字系统，无论是CPLD 还是FPGA器件都需要利用软件工具来进行设计。可编程数字系统设计总体上一般可以分为设计输入、项目处理、设计校验和器件编程这四个主要过程。下面我们将一个简单的模60BCD计数器为例，说明可编程数字系统设计的基本流程、概念和方法，掌握Quartus II 软件的基本功能和操作，了解原理图输入方式的设计全过程。
一、设计项目输入
设计输入是设计者对系统要实现的逻辑功能进行描述的过程。设计输入有多种表达方式，本次我们主要学习图形输入法。
1.1 建立工程项目
1.打开Quartus II，在File菜单中选择New Project Wizard项，将出现工程项目建立向导对
话框。
2.点击“Next”，进入到相应的对话框，在最上面的文本输入框中输入项目所在的目录名（注
意：不能用中文名，下同），在中间的文本输入框中输入项目名称，在最下面的文本输入框中输入最顶层模块的名称。
3.点击“Next”,进入到设计文件选择对话框，由于在本例中还没有任何设计文件，所以不
选择任何文件。
4.点击“Next”，进入到器件选择对话框，在“Family”下拉菜单中选择“Cyclone”,在“Available
Devices”列表栏中选择“EP1C3T144C8”。
5.点击“Next”进入到第三方EDA工具选择对话框，在这个界面我们可以选择第三方的综
合工具、仿真工具和时延分析工具。由于在本例中我们的综合、仿真和时延分析都采用Quartus II内置的工具，所以在这个页面不作任何选择。
6.点击“Next”进入到“Summary”对话框，在这个窗口列出了前面所作设置的全部信息。
点击“Finish”完成工程项目建立过程，回到主窗口。
1.2 建立原理图输入文件
在Quartus II中我们可以利用Block Editor以原理图的形式进行设计输入和编辑。Block Editor 可以读取并编辑后缀名为”.bdf”的原理图设计文件以及在MAX+PLUS II 中建立的后缀为”.gdf”的原理图输入文件。
1.在File菜单中选择New项，将出现新建文件对话框。选择“Device Design File/Block
Diagram/Schematic File”项。
2.点击“OK”,在主界面中将打开“Block Editor”窗口。“Block Editor”包括主绘图区和主绘
图工具条两部分。主绘图区是用户绘制原理图的区域，绘图工具条包含了绘图所需要的一些工具。简要说明如下：
选择工具：用于选择图中的器件、线条等绘图元素；
插入器件：从元件库内选择要添加的元件
插入模块：插入已设计完成的底层模块；
正交线工具：用于绘制水平和垂直方向的连线；
正交总线工具：用于绘制水平和垂直方向的总线；
打开/关闭橡皮筋连接功能：按下，橡皮筋连接功能打开，此时移动元件连接在元件上的连线也跟着移动，不改变同其他元件的连接关系；
打开/关闭局部正交连线选择功能：按下时打开局部正交连线选择功能，此时可以通过用鼠标选择两条正交连线的局部；
放大和缩小工具：按下时，点击鼠标左键放大，右键缩小显示绘图工作区；
全屏显示：将当前主窗口全屏显示；
垂直翻转：将选中的元件或模块进行垂直翻转；
水平翻转：将选中的元件或模块进行水平翻转；
旋转90度：将选中的元件或模块逆时针方向旋转90度；
元件的添加：在主绘图区双击鼠标左键，弹出相应的Symbol对话框，在name栏输入需添加的元件，如7400或nand2（二输入与非门），not（非门），vcc（5v电源、高电平），gnd（接地、低电平），input（输入引脚），output（输出引脚）等，回车或点击ok，此时在鼠标光标处将出现该元件图标，并随鼠标的移动而移动，在合适的位置点击
鼠标左键，放置一个元件。也可以利用插入器件工具来添加元器件，方法类似。
3.命名输入输出引脚：双击输入输出引脚的“PIN_NAME”，输入自己定义的名字即可。
4.器件的连接和修改：连接元器件的两个端口时，先将鼠标移到其中一个端口上，这时鼠
标指示符自动变为“+”形状，然后一直按住鼠标的左键并将鼠标拖到第二个端口，放开左键，则一条连接线被画好了。如果需要删除一根连接线，可单击这根连接线使其成高亮线，然后按键盘上的“Delete”键即可。
5.保存文件：从“File”菜单下选择“Save”，出现文件保存对话框。单击“OK”，使用默认的
文件名存盘。默认的文件名为项目顶层模块名加上“.bdf”后缀。
二、设计项目处理
在完成输入后，设计项目必须经过一系列的编译处理才能转化为可以下载到器件内的编程文件。
1.点击主工具栏上的按钮，开始“Analysis and Synthesis”编译过程。注意应该将要编译
的文件设置成顶层文件才能对它进行编译，设置方法为：点击左边Project Navigator/files ，打开files/Device Design Files，选中要编译的bdf文件，点击鼠标右键，在弹出的菜单中选择Set as Top-level Entity。
2.在项目处理过程期间，所有信息、错误和警告将会在自动打开的信息处理窗口中显示出
来。如果有错误或警告发生，双击该错误或警告信息，就会找到该错误或警告在设计文件中的位置。其中错误必须要修改，否则无法执行后续的项目处理，对于警告则要分情况处理。
3.分配引脚：Analysis and Synthesis全部通过后，为了把我们的设计下载到实际电路中进
行验证，还必须把设计项目的输入输出端口和器件相应的引脚绑定在一起。有两种方法可以实现这个过程，一种是给引脚分配信号，另一种则是给信号分配管脚。在此只介绍给信号分配管脚的方法：
选择菜单Assignments→Pins，”Assignments Editor”窗口。选择菜单View→Show All Known Pin Names，此时编辑器将显示所有的输入输出信号，其中“To”列是信号列，“Location”列是引脚列，“General Function”列显示该引脚的通用功能。对于一个输入输出信号，双击对应的“Location”列，在弹出的下拉列表框内选择需要绑定的管脚号。完成所有引脚的绑定，保存修改，此时原理图设计文件将给输入输出端口添加引脚编号。
4、布局布线、生成编程文件和时序分析：Analysis and Synthesis和管脚分配完成后，可以
点击进行全编译
三、设计项目校验
在完成设计输入和编译后，我们可以通过软件来检验设计的逻辑功能和计算设计的内部定时是否符合设计要求。常见的设计项目校验包括功能仿真、定时分析和时序仿真。
3.1 建立输入激励波形文件（.vmf）：
在做仿真之前，必须要先建立波形激励文件，具体步骤如下：
1.在“File”菜单中选择“New”打开新建文件对话框，在“Other Files”中选择“Vector
Waveform File”项后选择“OK”。
2.编辑器窗口的节点名称栏(Name)空白处单击鼠标右键，在该菜单中选择“Insert Node or
Bus…”项，弹出Insert Node or Bus对话框，点击“Node Finder”按钮，打开“Node Finder”
对话框，单击“List”按钮可以在“Nodes Found”栏中看到在设计中的所有输入/输出信号，当选中信号时，蓝色高亮，表示被选中。单击“≥”按钮可将选中的信号移动到“ Selected Nodes”区，表示可对这些信号进行观测。点击“OK”按钮，回到“Insert Node or Bus”对话框，再点击该对话框的“OK”按钮。
3.从菜单“File”中选择“Save ”，将此波形文件保存为默认名，扩展名“.vmf”表示仿真波形
激励文件。
3.2 为输入信号建立输入激励波形：
在波形文件中添加好输入/输出信号后，就可开始为输入信号建立输入激励波形。
1.在“Tools”菜单中选择“Options”项，打开参数设置对话框，选择“Waveform Editor”项设置
波形仿真器参数。在这个对话框里我们设置“Snap to grid”为不选中，其他为缺省值即可。
2.从菜单“Edit”下选择“End Time”项，弹出终止时间设定对话框，根据设计需要设置仿真
终止时间。
3.利用波形编辑器工具栏提供的工具为输入信号赋值，工具栏中主要按钮的功能介绍如
下：
放大和缩小工具：利用鼠标左键放大/右键缩小显示仿真波形区域；
全屏显示：全屏显示当前波形编辑器窗口；
赋值“0”：对某段已选中的波形，赋值…0?，即强0；
赋值“1”：对某段已选中的波形，赋值…1?，即强1；
时钟赋值：为周期性时钟信号赋值；
4.用鼠标左键单击“Name”区的信号，该信号全部变为黑色，表示该信号被选中。用鼠标
左键单击按钮即可将该信号设为”1”。设置时钟信号方法：选中信号，单击工具条
中的按钮打开Clock对话框，输入所需的时钟周期，单击“OK”关闭此对话框即可生成所需时钟。
5.选择“File”中“Save”存盘。到此完成激励波形输入。
3.3 功能仿真
可编程系统的仿真一般分为功能仿真和时序仿真。其中功能仿真，主要是检查逻辑功能是否正确。功能仿真方法如下：
1．在“Tools”菜单下选择“Simulator Tool”项，打开“Simulator Tool”对话框。在“Simulator Mode”下拉列表框中选择“Functional”项，在“Simulation input”栏中指定波形激励文件。
单击“Generator Functional Simulator Netlist”按钮，生成功能仿真网表文件。
2．仿真网表生成成功后，点击“Start”按钮，开始功能仿真。仿真计算完成后，点击“Report”
按钮，打开仿真结果波形。
3．观察输出波形，检查是否满足设计要求。
3.4 时序仿真
时序仿真则是在功能仿真的基础上利用在布局布线中获得的精确延时参数进行的精确仿真，一般时序仿真的结果和实际结果非常的接近，但由于要计算大量的时延信息，仿真速度比较慢。时序仿真的详细步骤如下：
1.在“Simulator Tool”对话框的“Simulator Mode”下拉列表框中选择“Timing”项，在
“Simulation input”栏中指定波形激励文件。
2.点击“Start”按钮，开始时序仿真。仿真计算完成后，点击“Report”按钮，打开和功能仿
真类似仿真结果波形。
四、器件编程
器件编程是使用项目处理过程中生成的编程文件对器件进行编程的，在这个过程中可以对器件编程、校验、试验，检查是否空白以及进行功能测试。
4.2 Quartus II器件编程
1、用下载电缆将计算机并口和实验设备连接起来，接通电源。
2、选择Tools Programmer菜单，打开Programmer窗口。
在开始编程之前，必须正确设置编程硬件。点击“Hardware Setup”按钮，打开硬件设置口。
3、点击“Add Hardware”打开硬件添加窗口，在“Hardware type”下拉框中选择
“ByteBlasterMV or ByteBlaster II”，“Port”下拉框中选择“LPT1”，点击OK按钮确认，关闭Hardware Setup窗口，完成硬件设置。
4、将模式mode选为JTAG方式下载。
5、将Program/Configure选中。
6、点击“Start”按钮，开始编程。
Quartus II 的使用 (2) 1 工程建立 (2) 2 原理图的输入 (5) 3 文本编辑（verilog） (15) 4 波形仿真 (16)
Quartus II 的使用 在这里，首先用最简单的实例向读者展示使用Quartus II软件的全过程。进入WINDOWS XP后，双击Quartus II图标，屏幕如图1.1所示。 图 1.1 Quartus II 管理器 1.1 工程建立 使用New Project Wizard，可以为工程指定工作目录、分配工程名称以及指定最高层设计实体的名称。还可以指定要在工程中使用的设计文件、其它源文件、用户库和EDA 工具，以及目标器件系列和器件（也可以让Quartus II 软件自动选择器件）。 建立工程的步骤如下：
（1）选择File菜单下New Project Wizard ，如图1.2所示。 图 1.2 建立项目的屏幕 （2）输入工作目录和项目名称，如图1.3所示。可以直接选择Finish，以下的设置过程可以在设计过程中完成。 图 1.3 项目目录和名称
（3）加入已有的设计文件到项目，可以直接选择Next，设计文件可以在设计过程中加入，如图1.4所示。 图 1.4 加入设计文件 （4）选择设计器件，如图1.5所示。 图 1.5 选择器件
（5）选择第三方EDA综合、仿真和时序分析工具，如图1.6所示。 图 1.6 选择EDA 工具 （6）建立项目完成，显示项目概要，如图1.7所示。 图 1.7 项目概要 1.2 原理图的输入 原理图输入的操作步骤如下：
（1）选择File 菜单下New ，新建图表/原理图文件，如图1.8 所示。 图 1.8 新建原理图文件 （2）在图1.9的空白处双击，屏幕如图1.10所示： （3）在图1.10的Symbol Name 输入编辑框中键入dff后，单击 ok按钮。此时可看到光标上粘着被选的符号，将其移到合 适的位置（参考图 1.11）单击鼠标左键，使其固定； （4）重复（2）、（3）步骤，给图中放一个input、not、output 符号，如图1.11所示；在图1.11中，将光标移到右侧input 右侧待连线处单击鼠标左键后，再移动到D触发器的左侧 单击鼠标左键，即可看到在input和D触发器之间有一条 线生成；
Quartus Ⅱ入门教程 (一个Verilog 程序得编译与功能仿真) Quartus Ⅱ 就是Altera 公司推出得专业EDA 工具,支持原理图输入、硬件描述语言得输入等多种输入方式。硬件描述语言得输入方式就是利用类似高级程序得设计方法来设计出数字系统。接下来我们对这种智能得EDA 工具进行初步得学习。使大家以后得数字系统设计更加容易上手。 第一步:打开软件 快捷工具栏:提供设置(setting),编译(pile)等快捷方式,方便用户使用,用户也可以在菜单栏得下拉菜单找到相应得选项。● 菜单栏:软件所有功能得控制选项都可以在其下拉菜单中找到。 ● 信息栏:编译或者综合整个过程得详细信息显示窗口,包括编译通过信息与报错信息。 第二步:新建工程( Project Wizard ) 1 工程名称: 快捷工具栏 菜单栏 所建工程得保存路径 工作区 资源管理窗口 任务管理窗口
dqgxo 。 2添加已有文件(没有已有文件得直接跳过next ) 3 选择芯片型号(我们选择MAX3000A 系列下得EPM3256AQC208-10芯片) (注:如果不下载到开发板上进行测试,这一步可以不用设置) 工程名称 顶层模块名(芯片级设计为实体名),要求与工程名称相同 如果有已经存在得文 件就在该过程中添加, 软件将直接将用户所添加得文件添加到工程中。
4 选择仿真,综合工具(第一次实验全部利用quartus 做,三项都选None,然后next) 5 工程建立完成(点finish ) 所选得芯片得系列型号 快速搜索所需得芯片 选择芯片 选择第三方综合工具,如果使用Quartus 内部综合工具则选择none 选择第三方仿真工具,如果使用Quartus 内部仿真工具则选择none 选择时序分析仪
Quartus II 的使用 (1) 1 工程建立 (1) 2 原理图的输入 (4) 3 文本编辑（verilog） (14) 4 波形仿真 (17)
Quartus II 的使用 在这里，首先用最简单的实例向读者展示使用Quartus II软件的全过程。进入WINDOWS XP后，双击Quartus II图标，屏幕如图1.1所示。 图 1.1 Quartus II 管理器 1.1 工程建立 使用New Project Wizard，可以为工程指定工作目录、分配工程名称以及指定最高层设计实体的名称。还可以指定要在工程中使用的设计文件、其它源文件、用户库和EDA 工具，以及目标器件系列和器件（也可以让Quartus II 软件自动选择器件）。 建立工程的步骤如下：
（1）选择File菜单下New Project Wizard ，如图1.2所示。 图 1.2 建立项目的屏幕 （2）输入工作目录和项目名称，如图1.3所示。可以直接选择Finish，以下的设置过程可以在设计过程中完成。 图 1.3 项目目录和名称
（3）加入已有的设计文件到项目，可以直接选择Next，设计文件可以在设计过程中加入，如图1.4所示。 图 1.4 加入设计文件 （4）选择设计器件，如图1.5所示。 图 1.5 选择器件
（5）选择第三方EDA综合、仿真和时序分析工具，如图1.6所示。 图 1.6 选择EDA 工具 （6）建立项目完成，显示项目概要，如图1.7所示。 图 1.7 项目概要 1.2 原理图的输入 原理图输入的操作步骤如下：
（1）选择File 菜单下New ，新建图表/原理图文件，如图1.8 所示。 图 1.8 新建原理图文件 （2）在图1.9的空白处双击，屏幕如图1.10所示： （3）在图1.10的Symbol Name 输入编辑框中键入dff后，单击ok按钮。此时可看到光标上粘着被选的符号，将其移到合适的位置（参考图 1.11）单击鼠标左键，使其固定；（4）重复（2）、（3）步骤，给图中放一个input、not、output 符号，如图1.11所示；在图1.11中，将光标移到右侧input 右侧待连线处单击鼠标左键后，再移动到D触发器的左侧单击鼠标左键，即可看到在input和D触发器之间有一条线生成；
FPGA入门及Quartus II使用教程FPGA是英文Field Programmable Gate Array的缩写，即现场可编程门阵列，它是在可编程阵列逻辑PAL(Programmable Array Logic)、门阵列逻辑GAL(Gate Array Logic)等可编程器件的基础上上进一步发展的产物。 可以这样讲，ASIC(Application Specific Integrated Circuit )内部的所有资源，是用积木堆积起来的小房子，可以是一个欧美风情的房子，还可以是一个北京四合院…….而FPGA内部就可以说是一个个小积木，也就是内部有大量的资源提供给我们，根据我们的需求进行内部的设计。并且可以通过软件仿真，我们可以事先验证设计的正确性。 第一章FPGA的基本开发流程 下面我们基于Altera 公司的QuantusII 软件来说明FPGA 的开发流程。 下图是一个典型的基于Quartus II的FPGA开发整体流程框图。
1、建立工程师每个开发过程的开始，Quartus II以工程为单位对设计过程进行管 理。 2、建立顶层图。可以这样理解，顶层图是一个容器，将整个工程的各个模块包 容在里边，编译的时候就将这些模块整合在一起。也可以理解为它是一个大元件，比如一个单片机，内部包含各个模块，编译的时候就是生成一个这样的大元件。 3、采用ALTERA公司提供的LPM功能模块。Quartus软件环境包含了大量的常 用功能模块，比如计数器、累加器、比较器等等。 4、自己建立模块。由于有些设计中现有的模块功能不能满足具体设计的要求， 那就只能自己设计。使用硬件描述语言，当然也可以用原理图的输入方法，可以独立的把它们当成一个工程来设计，并且生成一个模块符号(Symbol)，类似于那些LPM功能模块。这里可以理解为，如果我们需求的滤波器，没有现成的合适的，那我们可以通过LC自己来搭建一个滤波器。 5、将顶层图的各个功能模块连线起来。这个过程类似电路图设计，把各个芯片 连起来，组成电路系统。 6、系统的功能原理图至此已经基本出炉了，下一步就是选择芯片字载体，分配 引脚，设置编译选项等等。 7、编译。这个过程类似软件开发里德编译，但是实际上这个过程比软件的编译 复杂的多，因为它最终要实现硬件里边的物理结构，包含了优化逻辑的组合，综合逻辑以及布线等步骤。 8、编译后会生成2个文件，一个是*.sof文件，一个是*.pof文件，前者可以通过 JTAG方式下载到FPGA内部，可以进行调试，但断电后数据丢失；后者通过AS或者PS方式下载到FPGA的配置芯片里边（EEPROM或者FLASH），重新上电后FPGA会通过配置将数据读出。 9、对于复杂的设计，工程编译好了，我们可以通过Quartus软件或者其他仿真 软件来对设计进行反复仿真和验证，直到满足要求。（主要是时序仿真）。 第二章基于Quartus II的实例 一、建立工程 首先，打开Quartus II软件。
Quartus II入门详细教程实例讲解 写在前面： 1.本教程适合以前没有接触过QuartusII开发软件的新手，本教程是基础的入门，后续的学习还得大家自己努力。 2.本教程非常详细手把手带大家入门，网上现存的很多教程，有的过于跳跃，难以跟上；有的遇到错误，但教程没有指出，导致我们不知道怎么做。 3.本教程首先通过简单的仿真实验带大家入门。VHDL源代码会附在文档最后。 4.本教程使用Quartus II 9.1版本进行演示，其他版本的操作差别不是太大，也可以进行学习。 目录 一、Quartus II开发软件基本介绍 1.1 Quartus Ⅱ简介 Quartus Ⅱ是Altera公司推出的专业EDA工具，支持原理图输入、硬件描述语言的输入等多种输入方式。硬件描述语言的输入方式是利用类似高级程序的设计方法来设计出数字系统。 1.2 Quartus Ⅱ开发流程 使用Quartus II 软件进行开发的流程如图1.2.1所示。需注意的是，Quartus II还可以使用命令行模式的TCL批处理脚本进行自动流程控制。
图1.2.1 Quartus Ⅱ开发流程 二、用3-8译码器的设计介绍QuartusⅡ的基本使用方法（VHDL仿真） 1.1打开软件 双击桌面安装好的QuartusⅡ 9.1图标，打开软件，主页面如图1所示。 图1 在图1中，1区为菜单栏：软件所有功能的控制选项都可以在其下拉菜单中找到。2区为快捷工具栏：提供设置（setting），编译（compile）等快捷方式，方便用户使用，用户也可以在菜单栏的下拉菜单找到相应的选项。3区为资源管理窗口。4区为编译及综合的进度栏：编译和综合的时候该窗口可以显示进度，当显示100%是表示编译或者综合通过。5区为工作区。6区为信息栏：编译或者综合整个过程的详细信息显示窗口，包括编译通过信息和报错信息。
Quartus II简明教程 Altera公司的Quartus II设计软件是用来进行SOPC(System-on-a-programmable-chip)设计的综合的设计环境。本教程适用于Quartus II软件的新用户，介绍使用Quartus II软件的进行FPGA设计的基本方法。需要注意，本教程并不是Quartus II软件的详尽的参考手册。 本教程包含的主要内容： 1、典型的FPGA设计流程； 2、开始 3、新建project 4、设计输入 5、编译 6、引脚分配 7、仿真 8、编程、配置FPGA器件 9、板级调试
1、 典型的FPGA 设计流程 计算机辅助设计（Computer Aided Design ，CAD ）软件的使用使得使用可编程逻辑器件(Programmable Logic Device ，PLD)器件(比如Field Programmable Gate Array ，FPGA)进行数字逻辑电路设计变得非常容易。使用CAD 软件进行FPGA 设计的典型流程如图1所示。 图1 FPGA 设计的典型设计流程 Quartus II 软件支持以上设计流程的所有阶段。本教程介绍Quartus II 软件的基本特征。 2、 开始 在Quartus II 软件中设计的每个电路或者子电路都叫做项目（Project ）。Quartus II 软件每次只能打开一个Project ，并且一个Project 的所有信息都必须保存在同一个文件夹。为了开始一个新逻辑电路的设计，首先第一步就是新建一个文件夹来保存此Project 的文件。为了保存本教程的设计项目Project ，新建文件夹D:\introtutorial 。本教程运行的例子是一个简单两路开关控制电路。 启动Quartus II 软件，会打开如图2所示启动画面。启动画面中包含了使用Quartus II 软件所需要的
Quartus Ⅱ 9.0 使用教程（初级） Quartus Ⅱ 是Altera 公司推出的专业EDA 工具，支持原理图输入、硬件描述语言的输入等多种输入方式。硬件描述语言的输入方式是利用类似高级程序的设计方法来设计出数字系统。接下来我们对这种智能的EDA 工具进行初步的学习。使大家以后的数字系统设计更加容易上手。 第一步：打开软件 ● 快捷工具栏：提供设置（setting ），编译（ compile ）等快捷方式，方便用户使用，用户也可以在菜单栏的下拉菜单找到相应的选项。 ● 菜单栏：软件所有功能的控制选项都可以在其下拉菜单中找到。 ● 编译及综合的进度栏：编译和综合的时候该窗口可以显示进度，当 显示100%是表示编译或者综合通过。 ● 信息栏：编译或者综合整个过程的详细信息显示窗口，包括编译通过信息和报错信息。
第二步：新建工程（file>new Project Wizard ） 1 工程名称： 2添加已有文件（没有已有文件的直接跳过next ）
3 选择芯片型号（我们选择MAX3000A 系列下的EPM3256AQC208-10芯片） 4 选择仿真，综合工具（第一次实验全部利用quartus 做，三项都选None ，然后next ）
5 工程建立完成（点finish） 第三步：添加文件（file>new> VHDL file），新建完成之后要先保存。
第四步：编写程序 3-8译码器的VHDL描述源文件如下： library ieee; use ieee.std_logic_1164.all; entity decoder3_8 is port( A:in std_logic_vector(2 downto 0); EN:in std_logic; Y:out std_logic_vector(7 downto 0)); end decoder3_8; architecture example_1 of decoder3_8 is signal sel:std_logic_vector(3 downto 0); begin sel<=A & EN; with sel select Y <= "11111110" when "0001", "11111101" when "0011", "11111011" when "0101", "11110111" when "0111", "11101111" when "1001", "11011111" when "1011",
Quartus ii 10.0教程 说明 本文的部分章节，来源于本人翻译的Terasic DE2-115的英文入门文档。 平台 硬件：艾米电子EP2C8-2010增强版套件 软件：Quartus II 10.0 + ModelSim-Altera 6.5e (Quartus II 10.0) Starter Edition 内容 ?典型的CAD流程 ?开始 ?新建工程 ?录入Verilog设计 ?编译设计 ?引脚分配 ?仿真设计电路 ?编程及配置到FPGA器件 ?测试设计电路 典型的CAD流程 计算机辅助设计（CAD）软件，使得运用可编程逻辑器件实现所需逻辑电路，变得容易。比如现场可编程门阵列（FPGA）。典型的FPGA CAD设计流程如图1所示。
图1 典型的FPGA CAD设计流程 CAD流程包含以下步骤： ?设计输入——所需电路可通过原理图方式或硬件描述语言方式（如Verilog或VHDL）进行设计。 ?综合——输入的设计被综合进入由逻辑元素（LEs，FPGA芯片提供）组成的电路中。 ?功能仿真——综合电路被测试以验证其功能是否正确，次仿真不考虑时序因素。 ?布局布线——CAD Fitter工具决定网表中定义的LEs如何布置成FPGA芯片中的实际LEs。 ?时序分析——分析已布局布线电路中的不同路径的传播延迟，用以指示所需电路的性能。 ?时序仿真——测试已布局布线电路，验证其是否在功能和时序上都正确。 ?编程及配置——设计的电路，通过编程配置开关，被实现到一个物理的FPGA芯片。 配置开关用于配置LEs和建立所需线路连接。 本指南介绍Quartus II软件的基本特征。展示如何使用Verilog硬件描述语言来设计和实现电路。使用GUI来实现Quartus II指令。通过本份指南，读者将学习到： ?新建工程 ?使用Verilog代码录入设计 ?将综合的电路布局到Altera FPGA ?分配电路的输入输出到FPGA上的指定引脚 ?仿真设计电路 ?编程配置艾米电子EP2C8核心板上的FPGA芯片 1. 开始 在Quartus II中设计的每个逻辑电路或子电路，叫做一个工程。软件每次运行一个工程，并将所有信息保存在单一文件夹中。欲开始一个新的逻辑电路设计，第一步就是新建一个文件夹来保存文件。为了保存本指南的设计文件，在D盘新建introtutorial文件夹。指南者运行的范例为一个简单的双路灯控电路。 打开Quartus II软件，将看到类似于图2的画面。该显示画面包括若干窗口，用户可使用鼠标选择，以访问Quartus II软件的相关功能。Quartus II提供的大多数命令都可用菜单形式来访问。例如，在图2中，在File标签下点击左键，可打开如图3所示的菜单。用左键单击Exit可退出Quartus II软件。
第3章 Altera Quartus II软件开发向导 基于Altera Quartus II软件的设计方法有模块编辑法、文本编辑法、宏模块编辑法和包含前三种方法的混合编辑法。宏模块设计法放在第6章讲述，本章通过实例简单介绍使用Quartus II软件的模块原理图编辑法、文本编辑法和包含前两种方法的混合编辑法。 3.1模块编辑及设计流程 Quartus II软件的模块编辑器以原理图的形式和图标模块的形式来编辑输入文件。每个模块文件包含设计中代表逻辑的框图和符号。模块编辑器可以将框图、原理图或符号集中起来，用信号线、总线或管道连接起来形成设计，并在此基础上生成模块符号文件（.bdf）、AHDL Include文件（.inc）和HDL 文件。 3.1.1 原理图输入文件的建立 在这里我们设计非常简单一个二输入的或门电路。它只包含一个或门、两个输入引脚和一个输出引脚。首先创建一个原理图形式的输入文件。步骤如下： （1）打开模块编辑器 单击【File】|【New】，弹出新建文件对话框，如图3.1所示。 图3.1 新建文件对话框 选择文件类型【Block Diagram/Schematic File】，打开模块编辑器，如图3.2所示。使用该编辑器可以编辑图标模块，也可以编辑原理图。
·217· 图3.2 模块编辑器 Quartus II提供了大量的常用的基本单元和宏功能模块，在模块编辑器中可以直接调用它们。在模块编辑器要插入元件的地方单击鼠标左键，会出现小黑点，称为插入点。然后鼠标左键，弹出【Symbol】对话框，如图3.3所示。或者在工具栏中单击图标，也可打开该对话框。 图3.3 Symbol对话框 在Symbol对话框左边的元件库【Libraries】中包含了Quartus II提供的元件。它们存放在\altera\quartus60\libraries\的子目录下，分为primitives、others、megafunctions三个大类。 基本逻辑函数（primitives） 基本逻辑函数存放在\altera\quartus60\libraries\ primitives\的子目录下，分别为缓冲逻辑单元(buffer)、基本逻辑单元(logic)、其它单元(other)、引脚单元(pin)和存储单元(storage)五个子类。Buffer子类中包含的是缓冲逻辑器件，如alt_in buffer、alt_out_buffer、wire等；logic子类中包含的是基本逻辑器件，如and、or、xor等门电路器件；other子类中包含的是常量单元，如constant、vcc和gnd等；pin子类中包含的是输入、输出和双向引脚单元；storage子类中包含的是各类触发器，如dff、tff等。
目录 : Quartus II 的使用 (1) 1 工程建立 (1) 2 原理图的输入 (4) 3 文本编辑（verilog） (14) 4 波形仿真 (16)
Quartus II 的使用 在这里，首先用最简单的实例向读者展示使用Quartus II软件的全过程。进入WINDOWS XP后，双击Quartus II图标，屏幕如图1.1所示。 图 1.1 Quartus II 管理器 1.1 工程建立 使用 New Project Wizard，可以为工程指定工作目录、分配工程名称以及指定最高层设计实体的名称。 还可以指定要在工程中使用的设计文件、其它源文件、用户库和 EDA 工具，以及目标器件系列和器件（也可以让Quartus II 软件自动选择器件）。 建立工程的步骤如下：
（1） 选择File菜单下New Project Wizard ，如图1.2所示。 图 1.2 建立项目的屏幕 （2） 输入工作目录和项目名称，如图1.3所示。可以直接选择Finish，以下的设置过程可以在设计过程中完成。 图 1.3 项目目录和名称
（3） 加入已有的设计文件到项目，可以直接选择Next，设计文件可以在设计过程中加入，如图1.4所示。 图 1.4 加入设计文件 （4） 选择设计器件，如图1.5所示。 图 1.5 选择器件
（5） 选择第三方EDA综合、仿真和时序分析工具，如图1.6所示。 图 1.6 选择EDA 工具 （6） 建立项目完成，显示项目概要，如图1.7所示。 图 1.7 项目概要 1.2 原理图的输入 原理图输入的操作步骤如下：
在Quartus II中使用JTAG模式固化程序到EPCS中的方法.[Quartus II]范例 流水灯 图1 流水灯范例 实现步骤 步骤1： 在Quartus II中，单击File->Convert Programming Files..。打开编程文件转换程序，如图2所示。
图2 编程文件转换程序界面 在此界面中。在Programming file type:标签后选择JTAG Indirect Configuration File (.jjc)；在C onfiguration device:标签后选择你所使用的EPCS型号，此外我选择EPCS4。在Input file to conv ert方框中，单击Flash Leader，再单击Add Device..，如图3一样选择EP2C8（请根据自己的FPG A型号自行选择）；单击SOF Data，再单击Add File..，选择Quartus II编译后的sof文件。配置完成界面如图4所示。
图3 Add Device
图4 配置完成界面 单击Generate，开始生成jjc文件。成功界面如图5。 图5 成功界面 关闭Convert Programming Files界面，进入下一步骤。
步骤2： 在Quartus II中，单击Tools->Programmer，进入下载界面，如图6所示。 图6 下载界面 在此界面，单击Hardware Setup，选择下载线缆。双击选择Usb-Blaster，如图7所示。
图7 选择Usb-Blaster 回到下载界面，单击led_water.sof，再单击Change File..，选择刚才转换的output_file.jjc。添加完成后，安装图8所示勾选选项，选择jjc文件。 图8 选择jjc文件 单击Start，开始下载。下载完成后，请点击复位键或者重启开发板，就会看见固化的程序了。 友情提示：EPCS擦写次数有限（请自行查询），请尽量采用JTAG模式下载sof文件测试程序。
Quartus □入门教程 （一个Verilog 程序的编译和功能仿真） Quartus n 是Altera 公司推出的专业 EDA 工具，支持原理图输入、硬件描述语言的输 入等多种输入 方式。硬件描述语言的输入方式是利用类似高级程序的设计方法来设计出数字 系统。接下来我们对这种智能的 EDA 工具进行初步的学习。使大家以后的数字系统设计更 加容易上手。 \ ￡JJ 訓闿./ FYQcessho Ejdra Ihlo Inlo Wartimj —Citic-al Wairphj —入 E IKM A 5申卩旧貝6?:1 A Flaci / [Mswage: 快捷工具栏：提供设置（setting ），编译（compile ）等快捷方式，方便用户使用，用户也可 以在菜单栏的下拉菜单找到相应的选项。 菜单栏：软件所有功能的控制选项都可以在其下拉菜单中找到。 信息栏：编译或者综合整个过程的详细信息显示窗口，包括编译通过信息和报错信息。 For Help, press, Fl Idb 恤 UM 菜单栏 第一步：打开软件 快捷工具栏 Ale Proje Quartus II 的使用......................................... 错误!未定义书签。 1 工程建立 ................................................... 错误!未定义书签。 2 原理图的输入 ........................................... 错误!未定义书签。 3 文本编辑（verilog） ............................. 错误!未定义书签。 4 波形仿真 ................................................... 错误!未定义书签。 Quartus II 的使用 在这里，首先用最简单的实例向读者展示使用Quartus II软件的全过程。进入WINDOWS XP后，双击Quartus II图标，屏幕如图1.1所示。 图 1.1 Quartus II 管理器 1.1 工程建立 使用New Project Wizard，可以为工程指定工作目录、分配工程名称以及指定最高层设计实体的名称。还可以指定要在工程中使用的设计文件、其它源文件、用户库和EDA 工具，以及目标器件系列和器件（也可以让Quartus II 软件自动选择器件）。 建立工程的步骤如下： （1）选择File菜单下New Project Wizard ，如图1.2所示。 图 1.2 建立项目的屏幕 （2）输入工作目录和项目名称，如图1.3所示。可以直接选择Finish，以下的设置过程可以在设计过程中完成。 图 1.3 项目目录和名称 （3）加入已有的设计文件到项目，可以直接选择Next，设计文件可以在设计过程中加入，如图1.4所示。 图 1.4 加入设计文件 （4）选择设计器件，如图1.5所示。 图 1.5 选择器件 (笔记）Quartus II 与DE2 入门指导（Digital Logic） （DE2） 作者：yf.x来源：博客园发布时间：2010-03-04 21:18 阅读：1218 次原文链接[收藏] Version 1.0 By yf.x 03/03/2010 Abstract 通过一个简单的实例介绍Quartus II 9.1和DE2基本使用方法。 Introduction 典型的计算机辅助设计流程 开始 新建一个项目（project） Verilog设计输入 编译设计 管脚分配 仿真设计电路 规划、配置FPGA器件 测试设计的电路 一个典型的FPGA计算机辅助设计流程如图1所示。 图1 FPGA CAD设计流程 设计流程的步骤： ?设计输入（Design Entry）-- 用原理图或者硬件描述语言说明设计的电路。 ?综合（Synthesis）-- 将输入的设计综合成由FPGA芯片的逻辑元件（logic elements）组成的电路。 ?功能仿真（Functional Simulation）-- 测试、验证综合的电路功能正确与否，不考虑延时。 ?适配（Fitting）-- 将工程的逻辑和时序要求与器件的可用资源相匹配。它将每个逻辑功能分配给最佳逻辑单元位置，进行布线和时序分析，并选定相应的互连路径和引脚分配。 ?时序分析（Timing Analysis）-- 通过对适配电路的传播延迟的分析，提供电路的性能指标。 ?时序仿真（Timing Simulation）-- 验证电路的功能和时序的正确性。 ?编程和下载配置（Programming and Configuration）-- 在FPGA上实现设计的电路。 本文主要介绍Quartus II 的基本特性。演示如何用Verilog HDL在Quartus II平台设计和实现电路。包括： ?创建一个项目（project） ?用Verilog代码设计输入 ?综合 ?适配 ?分配管脚 ?仿真 ?编程与下载 1 创建一个项目 （1）启动Quartus II ，选择File > New Project Wizard，弹出窗口（图2） 超简明QuartusII教程 （CPLD篇） 黄俊 2007-9-29 https://www.doczj.com/doc/bc15790519.html,/index.php/2599 huangjun5927@https://www.doczj.com/doc/bc15790519.html, 在很多设计中，CPLD仅作为电路中的辅助元件，坦白地说，对大多数硬件开发工程师来说，CPLD部分的设计并不是他们主要的工作，并不想花太多时间去学习。QuartusII功能强大，但很多工具并不需要在CPLD设计中使用。 QuartusII使用极其方便，可简可繁，本文力争让读者在两小时内就掌握基本的使用方法。本文同样适用于FPGA设计的一部分，FPGA设计中涉及更深一些的时序分析、时序约束、逻辑分区，逻辑锁定，逻辑分析仪，功耗分析等等功能，所需工具较多，请参看其它教程。本文图片配合文字和箭头为主要讲解方式，所以需多用一下放大功能，在200%左右看插图时，可以清晰看到文字。 引子 CPLD基本设计流程如下： z工程管理——新建工程、工程管理； z源文件输入——VHDL/Verilog程序或原理图的设计，Altera内嵌模块的调用（对CPLD而言，只有MAXII还有内嵌模块可调）； z综合、编译——检查语法、连接错误，生成综合后网表； z功能仿真——综合后的功能仿真（可选）； z简单的约束——管脚分配、I/O特性约束（电平标准，驱动能力等）、简单的时序约束； z全编译——软件自动完成布局布线、生成最终编程文件； z时序仿真——带延时的和实际情况非常相近的时序仿真（推荐使用）； z编程——下载到硬件中。 实战 1、工程管理 a)新建工程 i.输入工程名， ii.选源文件 iii.选器件 iv.设置第三方工具 具体方法见下图。 在此有一个重要的设置需了解，即未用I/O的状态。 Q u a r t u s I I教程-CAL-FENGHAI.-(YICAI)-Company One1 第3章 Altera Quartus II软件开发向导 基于Altera Quartus II软件的设计方法有模块编辑法、文本编辑法、宏模块编辑法和包含前三种方法的混合编辑法。宏模块设计法放在第6章讲述，本章通过实例简单介绍使用Quartus II软件的模块原理图编辑法、文本编辑法和包含前两种方法的混合编辑法。 模块编辑及设计流程 Quartus II软件的模块编辑器以原理图的形式和图标模块的形式来编辑输入文件。每个模块文件包含设计中代表逻辑的框图和符号。模块编辑器可以将框图、原理图或符号集中起来，用信号线、总线或管道连接起来形成设计，并在此基础上生成模块符号文件 （.bdf）、AHDL Include文件（.inc）和HDL文件。 3.1.1 原理图输入文件的建立 在这里我们设计非常简单一个二输入的或门电路。它只包含一个或门、两个输入引脚和一个输出引脚。首先创建一个原理图形式的输入文件。步骤如下： （1）打开模块编辑器 单击【File】|【New】，弹出新建文件对话框，如图所示。 图新建文件对话框 选择文件类型【Block Diagram/Schematic File】，打开模块编辑器，如图所示。使用该编辑器可以编辑图标模块，也可以编辑原理图。 图模块编辑器 Quartus II提供了大量的常用的基本单元和宏功能模块，在模块编辑器中可以直接调用它们。在模块编辑器要插入元件的地方单击鼠标左键，会出现小黑点，称为插入点。然后鼠标左键，弹出【Symbol 】对话框，如图所示。或者在工具栏中单击图标，也可打开该对话框。 图 Symbol对话框 在Symbol对话框左边的元件库【Libraries】中包含了Quartus II提供的元件。它们存放在\altera\quartus60\libraries\的子目录下，分为primitives、others、megafunctions三个大类。 基本逻辑函数（primitives） 基本逻辑函数存放在\altera\quartus60\libraries\ primitives\的子目录下，分别为缓冲逻辑单元(buffer)、基本逻辑单元(logic)、其它单元(other)、引脚单元(pin)和存储单元(storage)五个子类。Buffer子类中包含的是缓冲逻辑器件，如alt_in buffer、alt_out_buffer、wire等； 217QuartusII教程(完整版)
(笔记)QuartusII9.1完全操作教程
超简明Quartus_II教程(CPLD篇)
quartusii教程
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